[毕业设计] PS2键盘接口芯片设计 [复制链接]

资料简介：
　　毕业设计 PS2键盘接口芯片设计 共50页，15830字
　　
摘  要
　　
虽然USB键盘、鼠标开始流行，但是PS/2设备仍然是PC机应用最广泛的设备。PS/2设备接口是由IBM开发并且最初出现在IBM技术参考手册里。PS/2鼠标和键盘履行一种双向同步串行协议，而且，不管通讯的方向怎样，鼠标/键盘总是产生时钟信号。如果主机要发送数据，它必须告诉设备开始产生时钟信号。
　　
本设计是基于FPGA芯片，应用硬件描述语言VHDL设计一个能与PS/2键盘相接口的界面电路，实现能够接收PS/2键盘产生的扫描码，并通过数码管显示按键的扫描码。该芯片还能实现与CRT显示器控制芯片相连接。在键盘上按下一个键，其对应的字符在显示器上显示出来。
　　
关键词： PS/2键盘；扫描码；FPGA芯片；硬件描述语言VHDL
　　

　　
目   录
　　
第1章 绪论    1
　　
1.1 设计的背景    1
　　
1.2 设计的内容    1
　　
1.3 设计的要求    1
　　
1.4 设计的总体思路    2
　　
第2章 PS/2键盘的硬件    3
　　
2.1 键盘的发展    3
　　
2.2 键盘原理    3
　　
2.2.1概述    3
　　
2.2.2 键的识别    3
　　
2.2.3 抖动的消除    5
　　
2.2.4 重键问题的解决    5
　　
2.3 扫描码     6
　　
2.3.1 扫描码的概念    6
　　
2.3.2 扫描码产生原理    7
　　
2.3.3 不同按键情况的扫描码    7
　　
2.3.4 扫描码集    8
　　
2.4 本章小结    8
　　
第3章 PS/2设备通信协议    9
　　
3.1 PS/2接口标准的发展过程    9
　　
3.2 PS/2接口硬件    10
　　
3.2.1 物理连接器    10
　　
3.2.2 电气特性     10
　　
3.3 通信过程    11
　　
3.3.1 一般描述    11
　　
3.3.2 PS/2设备到主机的通讯过程             12
　　
3.3.3 主机到设备的通讯过程                  13
　　
3.4 本章小结                                   14
　　
第4章 硬件介绍                              15
　　
4.1 概述                                        15
　　
4.2可编程逻辑器件介绍                          15
　　
4.2.1 可编程逻辑器件的发展历程              15
　　
4.2.2 可编程逻辑器件的功能                  16
　　
4.2.3 可编程逻辑器件的选择                  17
　　
4.3 FLEX10K系列器件                           18
　　
4.3.1 FLEX10K器件的特点                    18
　　
4.3.2 FLEX10K器件中的嵌入式阵列（EAB）      19
　　
4.4 EPF10K20RC240-4 器件简介                   19
　　
4.5 硬件连接框图                                20
　　
4.6 本章小结                                    20
　　
第5章 软件设计                                  21
　　
5.1接收并显示扫描码的设计                       21
　　
5.1.1 方案设计                               21
　　
5.1.2 接收数据模块                           23
　　
5.1.3 串并转换模块                           23
　　
5.1.4 FIFO模块                               23
　　
5.1.5 ASCII码转换模块                        24
　　
5.1.6 输出选择控制模块                       24
　　
5.1.7 输出译码模块                           25
　　
5.2 与CRT显示器连接的设计                     25
　　
5.2.1 方案设计                               25
　　
5.2.2 输出缓存模块                           25
　　
5.2.3 输出地址译码模块                       26
　　
5.3 设计的实现结果                              26
　　
5.4 本章小结                                  26
　　
结论                                        28
　　
致谢                                   29
　　
参考文献　　　　　　　　　　　　　　　　　  30
　　
附录                                        31

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