基于CPLD的VHDL语言数字钟（含秒表）设计 - 毕业设计|毕业论文|机械设计下载

nanyangrenke - 2008/12/24 14:58:05

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适用专业：应用电子
适用年级：大学
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论文编号：42408

资料简介：
　　课程设计基于CPLD的VHDL语言数字钟（含秒表）设计，共14页，3134字
　　
利用一块芯片完成除时钟源、按键、扬声器和显示器（数码管）之外的所有数字电路功能。所有数字逻辑功能都在CPLD器件上用VHDL语言实现。这样设计具有体积小、设计周期短（设计过程中即可实现时序仿真）、调试方便、故障率低、修改升级容易等特点。
　　
本设计采用自顶向下、混合输入方式（原理图输入—顶层文件连接和VHDL语言输入—各模块程序设计）实现数字钟的设计、下载和调试。

资料文件预览：
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课程设计-基于CPLD的VHDL语言数字钟（含秒表）设计
2007123122585410300.doc [182.50KB]

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inthesun2009 - 2009/1/22 6:09:47

我也要啊

hplmx - 2009/3/12 8:08:51

好难赚钱啊

you718 - 2009/6/10 15:03:40

很好

lcy198999 - 2009/11/2 3:23:16

好东西

liting423 - 2010/1/11 8:37:55

模具越来越火了，如何得到呢？

cahaya - 2012/12/16 20:00:20

楼主的资料太好了

sly7129001 - 2013/3/9 21:25:46

我做手机外壳注塑模设计

ygqslj3 - 2013/3/9 21:26:01

加油赚积分

ajax_21cn - 2013/3/9 22:02:00

进来看一下,顶了

liupeipei1224 - 2013/3/10 9:13:43

可惜看不见

xiaolong60205 - 2013/3/10 19:15:49

好帖子一定要顶！

努力赚够200积分，加油加油！

dengruif - 2013/5/23 16:20:49

谢谢，下来参考一下！

zhouxin1106 - 2013/5/23 16:29:10

分开上传应该就行了吧

youyou19821216 - 2013/8/20 13:32:55

谢谢！

lyshhaa - 2013/9/7 11:12:05

。。。。。。。。。。。。。。。。。

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